ハーバード・アーキテクチャの利点
出典: フリー百科事典『ウィキペディア（Wikipedia）』 (2021/08/10 01:12 UTC 版)
「ハーバード・アーキテクチャ」の記事における「ハーバード・アーキテクチャの利点」の解説
当時のコンピュータは単一プログラムの実行が主目的であり、命令をプログラムの実行中に書き換える必要は必ずしもなかった。ハーバード・アーキテクチャでは、命令をメモリから読むこととデータをメモリから読むことは競合せず、命令の処理が完了すると同時に次の命令を読み込むよう作ることができるため、アドレスバス、データバスを複数もたせる等すれば、高速化が可能であるというのが利点である。 これに対し、ノイマン型アーキテクチャではCPUが主記憶から同じ信号経路を使用して命令とデータの読み書きを行う。従って、CPUのクロック周波数がどんどん高速化するのに比し、主記憶のアクセス速度が追いつけなくなってくると、主記憶へのアクセスが足を引っぱるようになる。ノイマン型アーキテクチャにおけるフォンノイマンの隘路フォン・ノイマン・ボトルネックである。 現在でも，プログラムをユーザーが入れ換える必要がない、あるいはユーザーにアクセスさせたくないタイプのコンピュータ、たとえばマイクロコントローラの多くがハーバード・アーキテクチャをベースとしている。Atmel社の AVR シリーズ、マイクロチップ・テクノロジー社のPICなどがその例である。これらのプロセッサはプログラムメモリとワーキングメモリのアドレス空間を別にしており、プログラムメモリにはフラッシュメモリなど大容量（数K〜百数十KBytes）だが書き換えに時間がかかるものを、ワーキングメモリにはわずか（十数B〜数KBytes）だが高速でリフレッシュの必要のないSRAMをチップに内蔵している。特殊用途のプロセッサで高速性が求められるもの、たとえばデジタルシグナルプロセッサにも採用例が多く見られ、TIのTMS32010が代表例でAnalog Devices社のBlackfinなどでも使われている。 ノイマン型アーキテクチャにおいても，キャッシュメモリの実装方法において、インストラクションキャッシュとデータキャッシュという分け方をすることで、ハーバード・アーキテクチャを取り入れていると考えることができるケースもある。すなわち、最近の高性能プロセッサ（具体的にはインテルx86ならペンティアム以降）では、マイクロプロセッサ内のプロセッサコアとキャッシュメモリの構成を見るとハーバード・アーキテクチャになっているというものである。キャッシュメモリを含めてCPUとして見た場合は、外部の主記憶との構成は従来通りノイマン型アーキテクチャである。
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