SPARC T3
出典: フリー百科事典『ウィキペディア（Wikipedia）』 (2021/03/28 10:09 UTC 版)
ナビゲーションに移動 検索に移動| 生産時期 | 2010年から |
|---|---|
| 販売者 | オラクル |
| 設計者 | サン・マイクロシステムズ |
| CPU周波数 | 1.67 GHz |
| アーキテクチャ | SPARC V9 |
| コア数 | 8 or 16 |
| コードネーム | S2 |
| 前世代プロセッサ | UltraSPARC T2 |
| 次世代プロセッサ | SPARC T4 |
SPARC T3マイクロプロセッサ（以前はUltraSPARC T3 、コードネームRainbow Falls [1] 、開発中はUltraSPARC KTまたはNiagara-3とも呼ばれていた）は、オラクル（以前はサン・マイクロシステムズ ）によって製造されたマルチスレッドマルチコアCPUである[2][3][4]。 2010年9月20日に正式に発売され、 SPARCファミリのメンバーであり、UltraSPARC T2の後継である[5]。
パフォーマンス
全体的なシングルソケットおよびマルチソケットのスループットは、システムのT3プロセッサで向上し、CPUソケット要件の半分で前身のUltraSPARC T2+よりも優れたスループットを提供する。
スループット（SPEC CINT2006レート）は、以前のT2+プロセッサをデュアルソケットT5240プラットフォームで使った場合と比較して、シングルソケットT3-1プラットフォームで改善した[6][7]。
シミュレートされたウェブサービスのワークロードの下で、デュアルソケットベースのSPARC T3システムは、クアッドソケット（前世代）のUltraSPARC T2+システム（および競合するデュアルソケットとクアッドソケットの最新システム）よりも優れたパフォーマンスをベンチマークで記録した[8]。
歴史
オンラインIT出版「The Register」は、2008年6月に、このマイクロプロセッサは16個のコアがあり、それぞれに16個のスレッドが可能、と間違って報告した。 2009年9月に、彼らは代わりにコアごとに8個のスレッドがあるというロードマップを公開した[9]。 Hot Chips 21カンファレンスで、サンは、チップに合計16コアと128スレッドがあることを明らかにした[10][11]。 ISSCC 2010でのプレゼンテーションでは以下のことが披露された。
「16コアのSPARC SoCプロセッサにより、4-wayグルーレスシステムで最大512のスレッドが可能になり、スループットが最大化される。 461GB/sの6MB L2キャッシュと2.4Tb/sの308ピンSerDes I/Oは、必要な帯域幅をサポートする。 6つのクロックと4つの電圧ドメイン、ならびに電力管理回路技術、最適化性能、消費電力、377mm2ダイを通して変動や歩留まりのトレードオフ。」 [12]
2010年7月16日にTwitterのARCBotが未公開のPSARC/2010/274に注目し、 OpenSolarisに新しい「UltraSPARC T3の-xtarget値」が含まれていることを明らかにした。これによりUltraSPARC T3の存在が確認された[13]。
2010年9月20日にサンフランシスコで開催されたOracle OpenWorldの期間中、プロセッサは「SPARC T3」（名前に「Ultra」プレフィックスを削除）として正式に発売され、世界記録のパフォーマンスを主張する新しいシステムと新しい報告されたベンチマークが付属した[4]。 さまざまな実際のアプリケーションベンチマークがリリースされ、システム全体が開示された[14]。 国際的に認められたSPECベンチマークも、完全なシステム開示とともにリリースされた[15][16]。 オラクルは、SPARC T3が40 nmプロセスで構築されたことを明らかにした[17]。
特徴
SPARC T3の機能は次の通りである[17]。
- 8または16CPUコア
- コアあたり8つのハードウェアスレッド
- 6 MB L2キャッシュ
- 2つの組み込みコヒーレンシコントローラ
- 6つのコヒーレンスリンク
- コヒーレンスリンクごとに14の単方向レーン
- 接着回路なしの4ソケットへのSMP
- 4つのDDR3 SDRAMメモリチャネル
- 組み込みPCI Express I/Oインターフェース
- 各コアのセキュリティコプロセッサ。 DES、3DES、AES、RC4、SHA-1、SHA-256 / 384/512、Kasumi、Galois Field、MD5、最大2048キーのRSA、ECC、CRCをサポート
- ハードウェア乱数ジェネレータ
- 2つの組み込み1GigE/10GigEインターフェース
- 2.4 Tbit/sソケットあたりの総スループット
システム
SPARC T3チップのリリースに伴い、新しいブランドのオラクルSPARC Tシリーズサーバが市場に投入され、以前のSPARC Enterprise製品ラインのCMT（UltraSPARC T2/T2 Plus）マシンが置き換えられた。Tシリーズは以前のサーバ製品ラインアップに比べるとT3チップ搭載で更新されたサーバが少なくなり、サーバーの総数がそれぞれ4つに減った[18]。
- 1ソケットSPARC T3-12Uラックサーバ[19]
- 1ソケットSPARC T3-1Bブレードサーバ[20]
- 2ソケットSPARC T3-2サーバ[21]
- 4ソケットSPARC T3-4サーバ[22]
仮想化
以前のT1、T2、およびT2+プロセッサと同様に、T3は超特権実行モードをサポートする。 T3は、最大128のOracle VM Server for SPARCドメイン（以前は論理ドメインと呼ばれていた機能）をサポートする[22]。
T2およびT2+と比較した場合のパフォーマンスの向上
SPARC T3プロセッサは、事実上、1つのダイ上の2つのT2+プロセッサが搭載されている[23]。 T3の性能は以下の通り。
- T2/T2+のコア数から2倍の16になった
- T2+と比べて10ギガビットイーサネットポートが2倍の2つになった
- T2/T2+と比べて暗号アクセラレータコアが2倍の16になった
- 暗号化エンジンは、T2/T2+よりも多くの以下のアルゴリズムをサポート: DES、トリプルDES、AES、RC4、SHA-1、SHA256/384/512 、KASUMI、Galois Field、MD5、2048キーまでのRSA、ECC、CRC32[17]
- 暗号化パフォーマンスのスループットが1.9倍以上向上
- T2/T2+ DDR2インターフェイスより高速なDDR3RAMインターフェイス
- スループットが2倍になった[19]
- メモリ容量が2倍になった
- I/Oスループットが4倍になった
- 2つのPCIe2.08レーンインターフェイスと1つのPCIe旧世代8レーンインターフェイス[23]
関連項目
- UltraSPARC T1 – T2の前身であり、サン初の、チップでマルチスレッドを実現するCPU
- SPARC Tシリーズ
- SPARC T4
脚注
- ^ RAINBOW FALLS, Sun's Next Generation CMT Processor, 2009-08, retrieved 2016-01-13
- ^ High-end server chips breaking records | Speeds and Feeds - CNET News
- ^ Sun, IBM push multicore boundaries
- ^ a b Oracle Unveils SPARC T3 Processor and SPARC T3 Systems
- ^ Oracle Unveils SPARC T3 Processor and SPARC T3 Systems
- ^ Oracle Corporation SPARC T3-1, 2008-03, retrieved 2011-07-19
- ^ Sun SPARC Enterprise T5240, 2008-03, retrieved 2010-11-25
- ^ SPECweb2005, 2008-03, retrieved 2011-07-19
- ^ https://www.theregister.co.uk/2009/09/11/sun_sparc_roadmap_revealed/
- ^ Sanjay Patel, Stephen Phillips and Allan Strong. "Sun's Next-Generation Multi-threaded Processor - Rainbow Falls: Sun's Next Generation CMT Processor Archived 2011-07-23 at the Wayback Machine.". HOT CHIPS 21.
- ^ Stokes, Jon (February 9, 2010). "Two billion-transistor beasts: POWER7 and Niagara 3". Ars Technica.
- ^ J. Shin, K. Tam, D. Huang, B. Petrick, H. Pham, C. Hwang, H. Li, A. Smith, T. Johnson, F. Schumacher, D. Greenhill, A. Leon, A. Strong. "A 40nm 16-Core 128-Thread CMT SPARC SoC Processor". ISSCC 2010.
- ^ Twitter / ARCbot: PSARC/2010/274 New compiler
- ^ Brian Whitney (2010年9月27日). “SPARC T3-1 Shows Capabilities Running Online Auction Benchmark with Oracle Fusion Middleware”. BestPerf blog. Sun/Oracle. 2011年3月8日時点のオリジナルよりアーカイブ。2010年9月27日閲覧。
- ^ Kevin Kelly (2010年9月24日). “SPARC T3-2 sets World Record on SPECjvm2008 Benchmark”. BestPerf blog. 2010年11月26日時点のオリジナルよりアーカイブ。2010年9月27日閲覧。
- ^ Kevin Kelly (2010年9月20日). “SPARC T3-4 Sets World Record Single Server Result on SPECjEnterprise2010 Benchmark”. BestPerf blog. 2010年9月24日時点のオリジナルよりアーカイブ。2010年9月27日閲覧。
- ^ a b c “SPARC T3 Processor Data Sheet” (2010年). 2012年11月1日時点のオリジナルよりアーカイブ。2021年3月28日閲覧。
- ^ SPARC Servers
- ^ a b SPARC T3-1 | Web Infrastructure Server | Oracle
- ^ T3-1B | Best Blade for Infrastructure Apps | Oracle
- ^ SPARC T3-2 | Web Infrastructure Server | Oracle
- ^ a b SPARC T3-4 | Consolidation and Virtualization | Oracle
- ^ a b http://www.c0t0d0s0.org/archives/6921-SPARC-T3-some-data.html
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SPARC T3
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「SPARC Tシリーズ」の記事における「SPARC T3」の解説
詳細は「SPARC T3」を参照 2010年9月、オラクルは一連のSPARC T3プロセッサベースのサーバを発表した。 これらは「SPARC T3」シリーズとしてブランド化し、「SPARC Enterprise」ブランドは廃止された。 SPARC T3シリーズのサーバのT3-1Bは、Sun Blade 6000システムに収まるブレードサーバである。他のすべてのT3ベースのサーバはラックマウントシステムの形を取っている。以降のTシリーズサーバ世代には、同じSun Blade 6000フォームファクタのブレードサーバも含まれる。 オラクルと提携していた富士通では2011年2月からSPARC TシリーズのT3-1、T3-2、T3-4、T4-1、T4-2、T4-4についてSPARC Enterprise Tシリーズのラインで販売を続けたが、2015年12月にシリーズ全製品の販売終了した。富士通は2013年のSPARC M10からブランドをSPARC Serversに変更して、引き続きSPARC Mシリーズ、Tシリーズの販売を継続した。
※この「SPARC T3」の解説は、「SPARC Tシリーズ」の解説の一部です。
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