一般的なステータスレジスタの構成とは? わかりやすく解説

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一般的なステータスレジスタの構成

出典: フリー百科事典『ウィキペディア(Wikipedia)』 (2021/06/09 03:26 UTC 版)

ステータスレジスタ」の記事における「一般的なステータスレジスタの構成」の解説

一般にステータスレジスタは、そのプロセッサ命令による様々な演算などの結果などに関して「あふれが生じた」であるなどといったような対処必要な場合がある事象に関する状態(ステータス)を示すフラグと、割込みなどといったシステム制御する状態を示すフラグから成る。但し、6502のように演算でなく、レジスタへのロードのみでステータスレジスタ変化するものもある。 演算結果反映するものは、その後条件分岐などとして参照される場合が多いが ARM のように全命令条件フィールドがあり、条件付き実行が可能となっているCPUもある。条件分岐命令組み合わせるか、条件付き実行命令との組み合わせにするか状況に応じて選択が可能である。割込み禁止などのシステム制御するフラグへのアクセスOSなど(のみ)がおこなう「センシティブ命令」であるため、仮想化要件などが重視される近年プロセッサでは(詳細は「PopekとGoldbergの仮想化要件」を参照のこと)扱いやすさのために同一レジスタ内に共存させたりすることは避けられる(ないし、仮に実際ハードウェア内では共存していたとしても、システム的にユーザプロセスからは隔離されている)。 組込用や8ビット時代パソコンプロセッサなど、あるいはリセット直後保護モードに入る前のモード等、区別が無い場合もある。

※この「一般的なステータスレジスタの構成」の解説は、「ステータスレジスタ」の解説の一部です。
「一般的なステータスレジスタの構成」を含む「ステータスレジスタ」の記事については、「ステータスレジスタ」の概要を参照ください。

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