静的ハザードとは? わかりやすく解説

静的ハザード

出典: フリー百科事典『ウィキペディア(Wikipedia)』 (2022/05/06 22:47 UTC 版)

ハザード (論理回路)」の記事における「静的ハザード」の解説

静的ハザードは、1つ入力変数変化したときに正しい値に安定する前に出力瞬時変化する状況である。2種類の静的ハザードが存在する静的-1ハザード: 出力が1の状態で入力変化した後、出力一時的に0,1に変化した後に1に落ち着く 静的-0ハザード: 出力が0の状態で入力変化した後、出力一時的に1,0に変化した後に0に落ち着く 積和表現基づいて適切に作られた2レベルAND-OR論理回路では静的-0ハザード生じないが、逆に和積表現によるOR-ANDの実装では静的-1ハザード存在しない。 静的ハザードを排除するために最もよく使われる方法は、冗長論理論理式コンセンサス項)を加えることである。

※この「静的ハザード」の解説は、「ハザード (論理回路)」の解説の一部です。
「静的ハザード」を含む「ハザード (論理回路)」の記事については、「ハザード (論理回路)」の概要を参照ください。

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