プルダウン抵抗

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プルアップ抵抗

出典: フリー百科事典『ウィキペディア（Wikipedia）』 (2023/10/30 02:19 UTC 版)

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プルアップ抵抗（プルアップていこう、英: pull-up resistor）は、電子回路の信号入力端について開放時やそれに準ずる状況での電位不定を避けるために微少電流を流し続けるための抵抗を指す。

Lowアクティブの入力端子をプルアップ抵抗を介してVddなどの高電位電圧源に接続しておくことにより、開放時^[1]の電位不安定を防ぎ^[2]、高電位を保つ。入力端子より内側の抵抗である^[3]。同様に、Highアクティブの入力端をグランド（アース）^[4]など低電位に接続し、開放時に低電位を保つための抵抗はプルダウン抵抗と呼ばれる。

概要

以下、注記なき場合はCMOSのような、単電源で対称的な電子回路によるディジタル論理回路を前提とする。そのような回路へ入力は、通常High または Low と見なされる電圧が印加される前提であり、High とも Low ともみなされない中間電圧の状態は、論理的には動作不定であり、誤動作を起こす。これは、悪い場合には電気的/電力的な誤動作^[5]や破損につながりうる。回路の入力端子そのものが開放されているときや、そこに接続されている機器が電源やグランドに未接続といった俗にいう「浮いている」状態があると、周囲の静電気や電磁誘導により絶縁が破壊される危険性もある。その対策として、プルアップやプルダウンが必要となる。

プルアップ抵抗は、ある信号線と High に相当する電圧レベル（普通は電源）との間に挿入され、その配線への入力が「浮いている」ときに強制的に High 状態にする。その抵抗値は、Low 信号入力を阻害しないためにある程度大きい必要がある。

プルアップ処理を必要とする単純な例としては、外部からの入力のためのスイッチがある。通常そういったスイッチの配線は、 Low に対してスイッチONのとき接続、OFF状態で切断とされるがこれをプルアップする^[6]。

また、以上で述べた独立の入力の処理の他に、オープンコレクタの出力などを複数つなぐ場合の共通線をプルアップすることもある。実例としてはI²Cなど（後述）。

プルアップ/プルダウンの抵抗値は、一般的に次のような観点に基づいて決められる。優先順に、

1. 標準仕様/データシートで定められている場合は、まずその値が第一候補となる。
2. 端子が開放の場合の不定動作を防ぐために十分大きな電流を流す。（極端に大き過ぎる抵抗は用をなさない）
3. 通常の入力信号を阻害しないために電流を流しすぎないこと。（小さ過ぎる抵抗値でもいけない）
4. 電流ひいては消費電力が十分小さいこと。（電池駆動の機器などでは抵抗値をより吟味する必要がある）

また、CMOSのように対称な回路方式の場合はプルアップとプルダウンの関係も（理論上は）対称だが、非対称な回路方式の場合は非対称になる。

オープンコレクタ出力をプルアップした場合の出力結果

トランジスタの状態	出力	備考
OFF	Hi	プルアップ抵抗に接続されている電位になる
ON	Low	接地の電位になる

プルダウン抵抗

プルダウン抵抗（プルダウンていこう、英: pull-down resistor）は、プルアップ抵抗とは反対に、開放状態の入力端子を Low レベル電圧（通常、電位0V）に保つために使われる。

CMOSではその対称性から、原理的にはプルアップとプルダウンは対等といえる。

非対称な方式については、たとえばTTLの入力は開放時は自然に High となる。これをプルダウンで Low にするにはプルアップに比べて大きい電力を流す必要があり余計に電力消費する。そのためTTLではプルアップが好まれる。

実例

オープンコレクタのデジタル回路出力では、プルアップ抵抗が必要である。

バイポーラ論理ファミリは5Vで駆動され、プルアップ抵抗にはだいたい1kΩ～4.7kΩ程度を使う。抵抗値はその回路の電源や温度の特性を考慮して常に正しく動作するよう選択する。CMOSやMOS論理では、その高い入力インピーダンスに合わせ、220kΩ～1MΩ程度のより大きな値とすることができ、消費電力が少なくて済む。

出力側の例としては、TTLのICからリレーの開閉を制御する場合が挙げられる。TTLのICの Low 状態の出力をそのまま用いてもリレーを駆動することは出来ない。大電流を流すことの出来る増幅回路をもつ電圧入力の端子へ、プルアップ抵抗によって安定化された制御電圧（信号）を印加することで、安定した負荷制御を行う。

プルアップ抵抗はICチップ内に組み込まれていることもある。マイクロコントローラでは、入力端子毎にプログラマブルなプルアップ抵抗を内蔵しており、必要となる外部部品を極力少なくしているものが多い（プルダウン抵抗も内蔵していることもある）。

プルアップ抵抗の欠点として、電力消費が増える点と能動電流源に比べて速度が遅くなる点が挙げられる。論理ファミリによっては、プルアップ抵抗から流れ込む過渡電流に影響されやすく、プルアップ用に別のフィルタ付き電源を必要とする場合がある。

I²C

I2Cでは、クロック信号線とデータ信号線はプルアップされている（機器などの側はオープンコレクタ相当）

詳細は「I²C」を参照

I²Cでは、クロック信号線 (SCL) とデータ信号線 (SDA) にプルアップ抵抗が接続されており、機器側の端子はオープンコレクタ相当になっていて信号線をLowにすることができる。すなわち、なにもないときはいずれの信号線もHighになっている。

注

1. ^ 「浮いた」状態、ハイインピーダンス状態などとも呼ばれている
2. ^ 一般的には「どこにも接続されていない状態」は0ボルトとして扱われることも多いが、電子工学的にはそういった場合の電位は不定として扱われる。なお、実際的にも飛行機類の着地の際に地面との電位差がある場合があるので対策がとられているように、「どこにも接続されていない状態」の電位は不安定（不定）である。
3. ^ ここの説明において「入力」と「内部」の境界は任意である。どちらも実際には機器の内部にあることもあれば、ICの場合はICの「外部」にプルアップ抵抗を付けることも多い。
4. ^ 電圧が0の「電圧源」と言える。
5. ^ ラッチアップを起こしたり、貫通電流が流れてしまう、等
6. ^ あるいは「接続状態では High に駆動され、切断状態ではプルダウン抵抗により Low に駆動される」といったようにする。

参考文献

• Paul Horowitz and Winfield Hill, "The Art of Electronics 2nd Edition", Cambridge University Press, Cambridge, England, 1989 ISBN 0-521-37095-7

関連項目

• デジタル回路
• 論理回路

外部リンク

• Really basic introduction at Encoder

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プルダウン抵抗

出典: フリー百科事典『ウィキペディア（Wikipedia）』 (2022/04/24 14:16 UTC 版)

「プルアップ抵抗」の記事における「プルダウン抵抗」の解説

プルダウン抵抗（プルダウンていこう、英: pull-down resistor）は、プルアップ抵抗とは反対に、入力がない場合に Low レベルの電圧（通常、電位0V）にしておくために使われる。 CMOSではその対称性から、原理的にはプルアップとプルダウンは対称である。他の方式、特にその方式自体が対称ではない場合は対称でないことも多く、たとえばTTLの入力は何も接続されていない場合は自然に High になるため、プルダウンで Low にするには抵抗値を小さくする必要がある。そして、そうするとより多くの電力を消費する。そのためTTLではプルアップの方が好まれる。