Unique/priority if/caseとは? わかりやすく解説

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Unique/priority if/case

出典: フリー百科事典『ウィキペディア(Wikipedia)』 (2021/10/12 07:43 UTC 版)

SystemVerilog」の記事における「Unique/priority if/case」の解説

入れ子になった if や case 文において、unique属性指定することで必ず1つ分岐case)だけが実行されることを指示できる(どれも実行できない場合エラーとなる)。つまり、各ケース並行して実行可能である。if や case 文での priority属性条件順次評価していくことを示す。これまでアノテーションで synopsys full_case parallel_case を使って指示していたことを正式にキーワードとして指示できるようになったのである

※この「Unique/priority if/case」の解説は、「SystemVerilog」の解説の一部です。
「Unique/priority if/case」を含む「SystemVerilog」の記事については、「SystemVerilog」の概要を参照ください。

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