Superlog/System Verilogとは? わかりやすく解説

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Superlog/System Verilog

出典: フリー百科事典『ウィキペディア(Wikipedia)』 (2022/05/09 07:27 UTC 版)

Verilog」の記事における「Superlog/System Verilog」の解説

やがてOpenVeraやVerisityのE言語のようなハイ・レベル検証言語登場する。このことはその種の機能盛り込んだVerilog、すなわちコデザイン・オートメーション社によるSuperlogの開発促すこととなった。コデザイン・オートメーション社は、シノプシスによってその後買収された。SuperlogとVeraの基本部分はAccelleraに寄贈され次のIEEE標準としてSystemVerilogVerilogとに分かれた

※この「Superlog/System Verilog」の解説は、「Verilog」の解説の一部です。
「Superlog/System Verilog」を含む「Verilog」の記事については、「Verilog」の概要を参照ください。

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