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RISC

フルスペル：Reduced Instruction Set Computer
読み方：リスク
別名：縮小命令セットコンピュータ

RISCとは、CPUのアーキテクチャのうち、命令語長を固定とし、単純で基本的な命令語だけで命令セットを構成、処理効率の向上を図る設計のことである。

RISCは、従来のCPU設計では用意されていながらも実はほとんど役立っていなかった複雑な命令群を排除し、単純な命令のみに限ることで、パイプライン処理の高速化などを実現している。構成が簡単なので製造コストが比較的低く、消費電力も比較的低い。

RISCのアーキテクチャを採用したCPUとしては、SPARC、MIPS、Power PCなどを挙げることができる。

なお、RISCの概念に相対する、複雑な構造をもつ従来型のCPUのアーキテクチャは、CISC（Complex Instruction Set Computer）と呼ばれている。

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RISC

出典: フリー百科事典『ウィキペディア（Wikipedia）』 (2012/01/17 14:27 UTC 版)

(Reduced_instruction_set_computer から転送)

RISC（りすく、英: Reduced Instruction Set Computer、縮小命令セットコンピュータ）は、コンピュータの命令セットアーキテクチャ(ISA)の設計手法の一つで、命令の種類を減らし、回路を単純化して演算速度の向上を図るものである。なお、RISCが提唱されたときに、従来の設計手法に基づくアーキテクチャは対義語としてCISCと呼ばれる様になった。

RISCを採用したプロセッサ(CPU)をRISCプロセッサと呼ぶ。RISCプロセッサの例として、MIPS、POWER、SPARCなどが知られる。