マルチバスの構造とは? わかりやすく解説

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マルチバスの構造

出典: フリー百科事典『ウィキペディア(Wikipedia)』 (2020/05/14 01:48 UTC 版)

マルチバス」の記事における「マルチバスの構造」の解説

マルチバスいろいろな転送速度デバイス接続しながら、最大スループット維持できる非同期バスである。20本のアドレスラインがあり、最大1 Mbのマルチバスメモリと、1 MbI/O空間使用することができる。しかし、ほとんどのマルチバスI/Oデバイスは、アドレス空間最初64 Kbしかデコードていないマルチバスは、複数プロセッサや他のDMA装置共有するための、マルチマスタの機能サポートしている。 標準的なマルチバスフォームファクタは幅12インチ長さ6.75インチ回路基板であり、前面に、取り外しのための2つレバー持っているボード2つバス備えている。幅の広いP1バスは、マルチバス仕様定義されている。2つ目の、より小さP2バスはプライベートバスとして定義されている。

※この「マルチバスの構造」の解説は、「マルチバス」の解説の一部です。
「マルチバスの構造」を含む「マルチバス」の記事については、「マルチバス」の概要を参照ください。

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